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ADE7854/ADE7858/ADE7868/ADE7878
Table 5. HSDC Interface Timing Parameter
Data Sheet
Parameter
HSA to HSCLK Edge
HSCLK Period
Symbol
t SS
Min
0
125
Max
Unit
ns
ns
HSCLK Low Pulse Width
HSCLK High Pulse Width
Data Output Valid After HSCLK Edge
Data Output Fall Time
Data Output Rise Time
HSCLK Rise Time
HSCLK Fall Time
HSD Disable After HSA Rising Edge
HSA High After HSCLK Edge
t SL
t SH
t DAV
t DF
t DR
t SR
t SF
t DIS
t SFS
50
50
5
0
40
20
20
10
10
ns
ns
ns
ns
ns
ns
ns
ns
ns
HSA
HSCLK
t SS
t SL
t SFS
t DAV
t SH
t SF
t SR
t DIS
HSD
MSB
INTERMEDIATE BITS
t DF
t DR
LSB
Figure 7. HSDC Interface Timing
2mA
I OL
TO OUTPUT
PIN
C L
50pF
800μA
I OH
1.6V
Figure 8. Load Circuit for Timing Specifications
Rev. H | Page 14 of 100
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